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たとえば、図8は、マルチギガビット送受信装置(multi-gigabit transceiver:MGT801)、設定可能論理ブロック(configurable logic block:CLB802)、ランダムアクセスメモリブロック(BRAM803)、入出力ブロック(IOB804)、設定およびクロックロジック(CONFIG/CLOCKS805)、デジタル信号処理ブロック(digital signal processing block:DSP806)、専用入出力ブロック(I/O807)(たとえば、設定ポートおよびクロックポート)、および、デジタルクロックマネージャ、アナログ−デジタル変換器、システム監視論理などのような、他のプログラマブル論理808を含む、多くの数の異なるプログラマブルタイルを含むFPGAアーキテクチャ800を示す。

举例来说,图 8说明 FPGA架构 800,其包含大量不同的可编程瓦,包含多千兆位收发器 (MGT 801)、可配置逻辑块 (CLB 802)、随机存取存储器块 (BRAM 803)、输入 /输出块 (IOB 804)、配置与计时逻辑 (CONFIG/CLOCKS 805)数字信号处理块 (DSP 806)、专用输入 /输出块 (I/O 807)(例如,配置端口和时钟端口 )和其它可编程逻辑 808,例如数字时钟管理器、模 /数转换器、系统监视逻辑等等。 - 中国語 特許翻訳例文集

メモリアクセス調停手段110は、動き補償装置101からDMA要求111を受け取り、かつ複数個のビデオデコーダエンジン120−1,120−2,…,120−NからDMA要求をエンジンDMAバス116〜118を通じて受け取り、DMA要求を優先順位付けし、DMA ACK112を所定のDMA優先度リストに従って動き補償装置101及び複数個のビデオデコーダエンジン120−1,120−2,…,120−Nに送り、DMA入力データ及びDMA出力データをストリーム化し、DMA入力データ114を動き補償装置101に提供し、メインDMAバス151を通じて、フレームバッファ150からデータを読み取る、及びフレームバッファ150にデータを書き込む。

内存访问仲裁单元 110从动作补偿装置 101接收 DMA请求 111,并且通过引擎DMA总线 116~ 118从多个视频解码器引擎 120-1、120-2、 …、120-N接收 DMA请求,按照优先顺序排列DMA请求,根据规定的DMA优先级列表,将DMAACK112传输到动作补偿装置 101和多个视频解码器引擎 120-1、120-2、 …、120-N,使 DMA输入数据和 DMA输出数据进行流化,将 DMA输入数据 114提供给动作补偿装置 101,并通过主 DMA总线 151,从帧缓冲器 150读取数据、以及将数据写入到帧缓冲器 150。 - 中国語 特許翻訳例文集

本発明は、デジタル高周波処理技術を利用した近距離無線信号送受信技術に関し、より詳細には、近距離無線通信用送受信装置に適用され、送信しようとする近距離無線信号をデジタル高周波処理技術を用いて高周波(Radio Frequency)信号に変換して送信し、外部から受信される高周波信号から中間周波数信号を検出し、検出された中間周波数信号をデジタル信号に変換した後、前記デジタル信号を処理可能な近距離無線信号に変換するデジタル高周波処理技術を利用した近距離無線信号送受信装置及び方法に関する。

本发明涉及采用数字射频 (RF)处理的本地无线信号发送 /接收技术,更具体而言,涉及利用数字 RF处理技术的如下的本地无线信号发送 /接收装置及方法,该装置及方法被应用于本地无线通信的发送 /接收系统,以通过数字 RF处理将要发送的本地无线信号转换成 RF信号,发送该 RF信号,从外部的 RF信号中检测中频 (IF)信号,将检测到的 IF信号转换数字信号,然后,将该数字信号转换成可处理的本地无线信号。 - 中国語 特許翻訳例文集

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