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「データ方向レジスタ」の部分一致の例文検索結果

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サンプルホールド信号変換回路群4bは、各列において列方向に並ぶ2個の1ビットレジスタ回路毎に、該2個の1ビットレジスタ回路の保持データが入力される5個のデータ転送回路(Bit No.0,No.1データ転送回路〜Bit No.8,No.9データ転送回路)18bが列方向に配置されている。

采样保持信号转换电路组 4b中,在各列,对沿列方向排列的每 2个 1位寄存器电路,沿着列方向配置有输入有该 2个 1位寄存器电路的保持数据的数据传输电路 (Bit No.0,No.1数据传输电路~ Bit No.8,No.9数据传输电路 )18b,共 5个。 - 中国語 特許翻訳例文集

本実施形態では、5×5の垂直方向の5画素をそれぞれ初段のレジスタDin00〜Din04の入力へ同時に入力し、この入力動作を5回繰り返して、5×5のフィルタ演算に必要な画素データレジスタ群内の全てのレジスタに格納する。

在本实施例中,将 5×5块的垂直方向上的 5个像素同时输入至初级的寄存器的输入端口 Din00~ Din04,并且重复该输入处理 5次,以使得将 5×5滤波计算所需的像素数据存储在寄存器组 801中包括的所有的寄存器中。 - 中国語 特許翻訳例文集

図12において、サンプルホールド信号変換回路群4cは、各列方向において、1ビットレジスタ回路17毎に、1ビット転送を行うデータ転送回路18cが設けられている。

图 12中,采样保持信号转换电路组 4c在各列方向的每个 1位寄存器电路 1设有进行 1位传输的数据传输电路 18c。 - 中国語 特許翻訳例文集

サンプルホールド信号変換回路群4aは、列毎の垂直信号線9と1対1で配置される10ビット出力のADC16と、各列において対応するADC16が出力する10ビットデータを保持する10個の1ビットレジスタ回路(Bit No.0 Reg.〜Bit No.9 Reg.)17と、各2列において各行方向に並ぶ2個の1ビットレジスタ回路毎に列方向に配置される10個のデータ転送回路(Bit No.0 データ転送回路〜Bit No.9 データ転送回路)18aとを備えている。

采样保持信号转换电路组 4a具有与每列的垂直信号线 9一对一配置的 10位输出的 ADC16、在各列保持由对应的 ADC16输出的 10位数据的 10个 1位寄存器电路 (Bit No.0Reg.~ Bit No.9Reg.)17、按各 2列中并列于各行方向的 2个 1位寄存器电路来配置于列方向的 10个数据传输电路 (BitNo.0数据传输电路~ Bit No.9数据传输电路 )18a。 - 中国語 特許翻訳例文集





   

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